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小螃蟹的筆記本
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一個簡單的layout圖

記得是TSMC 1P5M25 製程,準備晶片下線最可憐的莫過於突然改完全不同的製程,那表示layout與simulation要重新來過。設計IC最重要的莫過於嶄新的idea與創新的系統概念,可惜我做了這麼久,覺得自己還有一些地方不是很懂,還需要努力才是。 話說這個晶片的原始概念是要節省電路的功率消耗,而節省功率的方法有很多種,這個電路是加入一個clock contro circuit,依據data transition 來 generate new clock,這個和現在公司做的gated clock有著類似的觀念。 和研究所時代相較之下,現在比較幸福的就是不用自己layout,畫圖雖然有趣但是很傷眼睛,不要小看只是各種不同的metal 來回穿梭,當schematic變的龐大複雜之後,轉換到layout的過程就變的很辛苦了。當然畫圖的方法也要經過學習才能變得有效率。 不過現在的工作比較偏向是integration,在RTL coding之後,使用logic synthesis 將前半段走完,這種兜電路的方式就不用自己慢慢的畫電路佈局圖,大公司分工細緻,將這些工作分給其他team,可以說是一種"聞道有先後、術業有專攻"。 算是一種好處吧~~
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